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一种降低并行ADC非线性误差的电容平均技术

上传者: 2020-08-30 02:58:51上传 PDF文件 131.7KB 热度 7次
提出了一种降低并行ADC中比较器失调的电容平均网络。该网络由比较器的输入失调存储电容和平均电容构成。通过理论推导和ADC系统级仿真,当平均电容与输入失调存储电容取值相等时,电容平均网络可以有效抑制70%以上的INL误差和DNL误差。
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