verilog SPI slave 上传者：a幸运4 2019-01-01 20:50:52上传 其他文件 500kb 热度 49次 下载地址 用户评论 更多下载 下载地址 立即下载 用户评论 码姐姐匿名网友 2019-01-01 20:50:54 没有用上 和我想的不一样 我要的是纯粹的slave 不知道这个是什么 码姐姐匿名网友 2019-01-01 20:50:54 挺不错的，学习了 码姐姐匿名网友 2019-01-01 20:50:54 比较简单 可以参考一下 码姐姐匿名网友 2019-01-01 20:50:54 拿来学习参考一下不错 码姐姐匿名网友 2019-01-01 20:50:54 学习学习，正好能用 码姐姐匿名网友 2019-01-01 20:50:54 要想符合自己的需要，还的自己编写。这个还能用！ 码姐姐匿名网友 2019-01-01 20:50:54 个人感觉有点过于复杂了，异步时钟的，有异步时钟的同步机制，但是MODSIM仿真仍然有时钟冲突现象。只好自己编了。 码姐姐匿名网友 2019-01-01 20:50:54 和之前找到的代码一样，这个程序挺好，不过整合到我自己的东西里头还需要大改 码姐姐匿名网友 2019-01-01 20:50:54 勉强能用，唉！ 码姐姐匿名网友 2019-01-01 20:50:54 正好可以用 但还不知道组合到自己设计的模块里怎么样 是FPGA4fun上面的代码 发表评论 a幸运4 资源：13 粉丝：0 +关注 上传资源 免责说明 本站只是提供一个交换下载平台，下载的内容为本站的会员网络搜集上传分享交流使用,有完整的也有可能只有一分部,相关内容的使用请自行研究,主要是提供下载学习交流使用,一般不免费提供其它各种相关服务! 本站内容泄及的知识面非常广,请自行学习掌握,尽量自已动脑动手解决问题,实践是提高本领的途径,下载内容不代表本站的观点或立场!如本站不慎侵犯你的权益请联系我们,我们将马上处理撤下所有相关内容！联系邮箱：server@dude6.com
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要想符合自己的需要，还的自己编写。这个还能用！
个人感觉有点过于复杂了，异步时钟的，有异步时钟的同步机制，但是MODSIM仿真仍然有时钟冲突现象。只好自己编了。
和之前找到的代码一样，这个程序挺好，不过整合到我自己的东西里头还需要大改
勉强能用，唉！
正好可以用 但还不知道组合到自己设计的模块里怎么样 是FPGA4fun上面的代码