译码器VHDL

Name: 译码器VHDL
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Author: marvie_xie

上传者：marvie_xie 2020-02-23 19:22:23上传 VHD文件 1.05KB 热度 40次

数字电路设计实验用VHDL语言实现的单数码管译码器

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译码器VHDL

数字电路设计实验用VHDL语言实现的单数码管译码器

大小：0B | 2020-02-23 19:22:23
VHDL译码器

大小：0B | 2019-01-11 22:01:20
通用译码器VHDL

通用译码器decoderVHDL语言

大小：0B | 2020-05-22 14:51:38
38译码器VHDL

基于fpga编写的VHDL3-8译码器。3个输入口，进行译码后在8个输出口输出。低电平有效

大小：0B | 2019-05-12 23:54:26
74139译码器vhdl设计

大小：0B | 2019-01-09 02:32:34
38译码器设计VHDL

3-8译码器设计全VHDL代码,仿真图形,硬件验证结果等等!!!

大小：0B | 2019-08-02 09:52:45
用VHDL设计138译码器

熟悉 max plusii 的基本操作，掌握文本输入法，了解 FPGA 的设计过程。

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VHDL语言的三八译码器

工程代码部分文件，讲过自己的测试，含有源代码和测试文件，可以直接仿真。

大小：0B | 2019-05-12 23:54:34
VHDL七段译码器

VHDL七段译码器，输入二进制代码，通过译码器，能够直接在数码管上显示

大小：0B | 2019-05-07 01:03:03
VHDL语言38译码器.docx

本文档内含FPGA课程中,使用VDHL语言设计一个3-8译码器的程序,与仿真图,以及板子实物拍摄,以...

大小：0B | 2020-11-12 15:39:26
VHDL实现38译码器.zip

使用，VHDL实现3-8译码器，QuartusII操作.可编程逻辑器件.

大小：0B | 2019-08-02 09:52:30
VHDL38译码器源码

VHDL实现38译码器功能。ENTITYYIMA38ISPORT(INPUT:INSTD_LOGIC...

大小：0B | 2020-05-15 07:26:06
VHDL实现3_8译码器

此工程实现了3-8译码器的编译与封装！编译的过程中未出现错误和警告，欢迎使用！

大小：0B | 2018-12-16 04:51:06
VHDL语言编写的38译码器

大小：0B | 2018-12-07 17:03:35
VHDL行为级描述的译码器设计

标准的2-4线译码器VHDL语言行为级描述设计，这个设计包含的工程文件通过ISE编译综合，经过仿真证...

大小：0B | 2019-07-11 06:20:03
3线8线译码器VHDL实现

大小：0B | 2019-02-17 05:43:29