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FPGA FIFO 实现关键代码

上传者: 2019-09-06 07:08:42上传 RAR文件 2.67MB 热度 27次
prj为工程文件存放目录rtl为verilog可综合代码img为设计相关图片存放目录(主要为了方便后期写文档)doc为设计相关文档存放目录testbench为对应的testbench存放目录prj文件夹下的ip文件夹存放quartusii中生成的ip核文件
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