基于门逻辑的四位乘法器

Name: 基于门逻辑的四位乘法器
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Author: stlinwx

上传者：stlinwx 2019-05-01 09:46:42上传 ZIP文件 6.74MB 热度 50次

用verilog写的纯门逻辑的4个四bit的数相乘的乘法器，流水线设计，仿真正确！

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基于门逻辑的四位乘法器

用verilog写的纯门逻辑的4个四bit的数相乘的乘法器，流水线设计，仿真正确！

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