异步FIFOVerilogHDL包含所有标志位通过验证

Name: 异步FIFOVerilogHDL包含所有标志位通过验证
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Author: y66197

上传者：y66197 2019-01-19 18:46:54上传其他文件 500kb 热度 42次

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: tian_su 2024-12-31 08:23:13

谢谢分享~谢谢分享~

异步FIFOVerilogHDL包含所有标志位通过验证

大小：0B | 2019-01-19 18:46:54
同步FIFOVerilogHDL通过验证包含所有标志位

同步FIFO的空、满、半满、将空、将满标志都有包含，代码通过modelsim验证

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