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文件是整个工程，包含verilog编写的数据、地址产生模块，包含testbench的测试代码，并用m...
大小：26.74MB | 2019-06-03 16:53:21 -
该例程中有fifo，sdram，以及pci9054的控制verilog程序
大小：3.67MB | 2019-05-28 02:11:11 -
大小：0 | 2019-01-02 10:04:49
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大小：0 | 2018-12-08 02:43:24
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