基于现场可编程门阵列的数控延时器的设计

本文详细介绍了利用VHDL硬件描述语言结合FPGA设计一种数控延时器的方法,讨论了延时范围,分析了延时误差,该延时器的设计旨在和DSP相结合实现对延时信号的处理。随着EDA技术的飞速发展。使用硬件描述语言设计FPGA是电子设计人员应该掌握的一门技术。同时,将DSP和FPGA技术相结合是进行数字信号处理的一种趋势。