VHDL 计算机整机实验

Name: VHDL 计算机整机实验
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Author: danyyung

上传者：danyyung 2019-09-08 15:24:31上传 RAR文件 2.81MB 热度 34次

目的：设计一个简化计算机模型CPU+MEM=>COMPUTER环境：QuartusII+DE2板附实验报告和VHDL源码，可下载到DE2板上运行

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