基于verilog的有限状态机(Counter)

Name: 基于verilog的有限状态机(Counter)
Rating: 4.5 (75 reviews)
Author: gcsunshine

上传者：gcsunshine 2019-07-22 23:26:57上传 V文件 985B 热度 75次

简单的有限状态机（Counter），8bit计数器，基于verilog语言

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: 码姐姐匿名网友 2019-07-22 23:26:57

代码值得参考，做毕设挺有用的

: 码姐姐匿名网友 2019-07-22 23:26:57

程序写的很好能运行出来

: 码姐姐匿名网友 2019-07-22 23:26:57

很好的代码,已经试验可以正常运行

基于verilog的有限状态机Counter

简单的有限状态机（Counter），8bit计数器，基于verilog语言

大小：0B | 2019-07-22 23:26:57
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