基于CPLD及C语言的等精度频率计设计

Name: 基于CPLD及C语言的等精度频率计设计
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Author: qq_84140565

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基于CPLD及C语言的等精度频率计设计的

大小：0B | 2018-12-25 20:56:58
基于fpga等精度频率计的设计频率计

基于fpga的等进度频率计采用VHD了编程等精度方法

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基于FPGA CPLD的32位等精度频率计

基于CPLD/FPGA的频率计，使用VHDL语言

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等精度频率计的设计

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基于FPGA的等精度频率计设计

介绍等精度测量原理及实现具体模块引脚信号介绍 verilog语言编写

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10HZ~10M测周期用数码管显示没有小数点

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基于单片机和CPLD的等精度频率计的设计

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基于CPLD和单片机的等精度频率计的设计

这是一篇硕士论文，其中的资料非常详细，所有的程序论文均有。

大小：0B | 2019-05-13 07:53:00
基于FPGA的等精度频率计

有图有真相源程序VERILOG写的

大小：0B | 2019-05-13 07:52:49
基于FPGA的等精度频率计的设计

基于FPGA的等精度频率计的设计，特别详细，有程序也有步骤，效果也很好

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等精度测频法采用门控信号和被测信号同步, 消除对被测信号计数产生的一个脉冲的误差。等精度频率测量方法...

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