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DCT/IDCT 硬件实现

上传者: 2019-07-16 23:03:33上传 RAR文件 8.42MB 热度 36次
DCTIDCT核使用verilog编写的,用到了stratix中的乘加模块。压缩包里共有两个核
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用户评论
码姐姐匿名网友 2019-07-16 23:03:33

还不错叭叭叭

码姐姐匿名网友 2019-07-16 23:03:33

一般,10分有点多了

码姐姐匿名网友 2019-07-16 23:03:33

在老师指定的芯片上编译通不过额,芯片资源太少了

码姐姐匿名网友 2019-07-16 23:03:33

也就凑合吧,收费太高啦

码姐姐匿名网友 2019-07-16 23:03:33

挺好用的,改一改就OK了。不错!