不恢复余数阵列除法器的FPGA实现 上传者：qq_20875331 2018-12-20 21:54:39上传 PDF文件 250.49KB 热度 41次 研究不恢复余数法的算法基础上，阐述以可控加／减法器(CAS)为基本组成单元的阵列除法器的构造原理，并给出一个完整的定点小数补码除法逻辑图，最后提出一种基于现场可编程门阵列(Field．ProgrammableGateArray，简称FPGA)的除法器的硬件实现方法． 下载地址 用户评论 更多下载
