FPGA实现 fir滤波器VHDL源码，本人在altera 芯片验证过（20Mhz时钟），处理速度和时钟同步 上传者：centron 2019-04-17 00:58:48上传 VHD文件 5.2KB 热度 26次 FPGA实现 fir滤波器VHDL源码，本人在altera 芯片验证过（20Mhz时钟），方法笨重，但是处理速度和时钟同步，有意向作者方面研究的可以邮箱（fpga_dsp@qq.com）联系，别忘了注明本人信息，本人在fpga方面有许多信号处理及通信方面的成果，也有不少经验 下载地址 用户评论 更多下载 下载地址 立即下载 用户评论 码姐姐匿名网友 2019-04-17 00:58:48 虽然使用VHDL写的，不过还是不错的，谢了 码姐姐匿名网友 2019-04-17 00:58:48 代码可行，多谢分享！ 码姐姐匿名网友 2019-04-17 00:58:48 东西很不错 就是分太高了 码姐姐匿名网友 2019-04-17 00:58:48 资源还不错，建议尝试下载 发表评论 centron 资源：19 粉丝：0 +关注 上传资源 免责说明 本站只是提供一个交换下载平台，下载的内容为本站的会员网络搜集上传分享交流使用,有完整的也有可能只有一分部,相关内容的使用请自行研究,主要是提供下载学习交流使用,一般不免费提供其它各种相关服务! 本站内容泄及的知识面非常广,请自行学习掌握,尽量自已动脑动手解决问题,实践是提高本领的途径,下载内容不代表本站的观点或立场!如本站不慎侵犯你的权益请联系我们,我们将马上处理撤下所有相关内容！联系邮箱：server@dude6.com
虽然使用VHDL写的，不过还是不错的，谢了
代码可行，多谢分享！
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