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用verilog语言描述的计数器,可用以电子表的设计,有六进制和十进制的计数器,有24进制的计数器
大小:1.59KB | 2019-07-24 23:09:18 -
A律PCM编码,对一个输入的抽样值(-2048到+2048),输出相应的8位编码值
大小:5.09KB | 2018-12-27 22:06:54
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用verilog语言描述的计数器,可用以电子表的设计,有六进制和十进制的计数器,有24进制的计数器
A律PCM编码,对一个输入的抽样值(-2048到+2048),输出相应的8位编码值