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本文档描述了整个ASIC芯片从需求分析,行为模块设计,行为模块验证,后端时序收敛,时序验证等等。讲述...
大小:4.52MB | 2019-07-23 15:32:08 -
本文档包含一个同步fifo 两个异步fifo的Verilog代码实现,并配有相应的仿真文档。
大小:4.37KB | 2018-12-20 13:39:25
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本文档描述了整个ASIC芯片从需求分析,行为模块设计,行为模块验证,后端时序收敛,时序验证等等。讲述...
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