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北航夏文宇verilog经典教材北航夏文宇verilog经典教材实用很不错的资源
大小:77.21MB | 2019-06-04 00:24:32 -
基于FPGA的正弦信号发生器,采用vhdl语言编程。
大小:128.02KB | 2018-12-20 10:37:31
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北航夏文宇verilog经典教材北航夏文宇verilog经典教材实用很不错的资源
基于FPGA的正弦信号发生器,采用vhdl语言编程。